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	<title>Neueste Beiträge &#8211; NHR</title>
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	<description>Nationales Hochleistungsrechnen</description>
	<lastBuildDate>Wed, 15 Jul 2026 15:43:12 +0000</lastBuildDate>
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	<title>Neueste Beiträge &#8211; NHR</title>
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		<title>GPU H200 partition of Lise installed</title>
		<link>https://nhr.zib.de/gpu-h200-2026/</link>
		
		<dc:creator><![CDATA[Christian Schimmel]]></dc:creator>
		<pubDate>Wed, 15 Jul 2026 08:58:24 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
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					<description><![CDATA[A new partition with 14 compute nodes holding NVIDIA H200 GPUs...]]></description>
										<content:encoded><![CDATA[<h2>GPU H200 partition of system Lise</h2>
<p>A new partition with 14 compute nodes holding NVIDIA H200 GPUs with 141 GB HBM memory is installed to satisfy the growing needs for AI-workloads at NHR@ZIB.</p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>Erweiterung AMD CPU-Partition</title>
		<link>https://nhr.zib.de/2026-amd-cpu-partition/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Thu, 14 May 2026 15:08:39 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
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					<description><![CDATA[Das NHR@ZIB nimmt die erweiterte Rechenpartition CPU Genoa für das System Lise in Betrieb.]]></description>
										<content:encoded><![CDATA[<h2>Erweiterung AMD CPU-Partition für das System &#8222;Lise&#8220;</h2>
<p>Das NHR@ZIB erweitert seine Rechnerpartition CPU Genoa für das System Lise. Die neue Partition besteht dann zusammen aus 250 CPU-Knoten. Jeder Rechenknoten besitzt zwei CPUs, jede CPU ist vom Typ AMD EPYC 9654 Genoa mit 96 Rechenkernen, und 1,5 TB Hauptspeicher. Das <span class="legacy-color-text-default">400 Gb/s InfiniBand-Kommunikationsnetzwerk ist so konfiguriert, dass über geteilte IO Interfaces effektiv 200 Gb/s pro Knoten erreicht werden können.</span></p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>Neues Speichersystem</title>
		<link>https://nhr.zib.de/neues-speichersystem/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Tue, 28 Jan 2025 12:19:37 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
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					<description><![CDATA[Das NHR@ZIB hat ein neues paralleles Speichersystem in Betrieb genommen.]]></description>
										<content:encoded><![CDATA[<h2>Neues Speichersystem für das System &#8222;Lise&#8220;</h2>
<p>Das NHR@ZIB hat ein neues paralleles Speichersystem für die Dateisysteme Home und Work auf System Lise in Betrieb genommen. Damit haben alle Projekte zusammen genommen Zugriff auf 20 PByte Festplattenspeicher über das parallele Dateisystem IBM Storage Scale. Die Dateisysteme verfügen über Volumen- und Inode-Quotas für groups und users. Die Quotas mit Soft- und Hard-Limits sowie grace periods können für Verzeichnisse konfiguriert werden.</p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>Neue AMD CPU-Partition</title>
		<link>https://nhr.zib.de/new-amd-cpu-partition/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Tue, 08 Oct 2024 07:18:09 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
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					<description><![CDATA[Das NHR@ZIB nimmt eine neue Rechnerpartition für das System Lise in Betrieb.]]></description>
										<content:encoded><![CDATA[<h2>Neue AMD CPU-Partition für das System &#8222;Lise&#8220;</h2>
<p>Das NHR@ZIB nimmt eine neue Rechnerpartition für das System Lise in Betrieb. Es besteht aus 168 CPU-Knoten. Jeder Rechenknoten besitzt zwei CPUs, jede CPU ist vom Typ AMD EPYC 9654 Genoa mit 96 Rechenkernen, und 1,5 TB Hauptspeicher. Das <span class="legacy-color-text-default">400 Gb/s InfiniBand-Kommunikationsnetzwerk ist so konfiguriert, dass über geteilte IO Interfaces effektiv 200 Gb/s pro Knoten erreicht werden können. Für eine Testphase ist die AMD CPU-Partition kostenfrei für die Nutzerinnen und Nutzer des NHR@ZIB verfügbar.</span></p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>System Lise auf Platz 3 in der IO500</title>
		<link>https://nhr.zib.de/daosio500/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Thu, 30 May 2024 11:10:02 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
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					<description><![CDATA[Das HPC-System Lise konnte sich mit seiner Installation des Speichersystems DAOS auf Platz 3 in der "10 node production"-Liste platzieren.]]></description>
										<content:encoded><![CDATA[<h2>HPC-System &#8222;Lise&#8220; des erreicht mit DAOS Platz 3 in der IO50</h2>
<p>Das HPC-System Lise konnte sich mit seiner Installation des Speichersystems DAOS auf Platz 3 in der &#8222;10 node production&#8220;-Liste platzieren. Für mehr Informationen lesen Sie bitte den <a href="https://www.zib.de/de/news/hpc-system-lise-des-nhr-zentrums-am-zib-erreicht-mit-daos-rang-3-der-io500">Artikel auf der ZIB-Webseite</a>.</p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>Accelerator Hackathon 2024</title>
		<link>https://nhr.zib.de/accelerator-hackathon-2024/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Fri, 01 Mar 2024 10:27:20 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
		<guid isPermaLink="false">https://nhr.zib.de/?p=16201</guid>

					<description><![CDATA[ZIB, ParTec and Next Silicon are excited to invite you to the upcoming technical Accelerator Hackathon.]]></description>
										<content:encoded><![CDATA[<h2>Accelerator Hackathon</h2>
<p>ZIB, ParTec and Next Silicon are excited to invite you to the upcoming technical Accelerator Hackathon. Join us in this 1.5 day hackathon to learn about the exciting new HPC approach from NextSilicon. This deep dive covers the programming environment, profiling analysis and optimization approach with dedicated hands-on sessions to allow participants to experience this novel hardware directly. The hackathon will take place</p>
<ul>
<li>at Zuse Institute Berlin</li>
<li>from March 21st to March 22nd 2024.</li>
</ul>
<p>For more information, please visit the <a href="https://user.nhr.zib.de/wiki/x/AYBeAQ">workshop page</a>.</p>
<p><img fetchpriority="high" decoding="async" class="size-medium wp-image-16231 aligncenter" src="https://nhr.zib.de/wp-content/uploads/2024/03/acceleratorv01-300x300.png" alt="" width="300" height="300" srcset="https://nhr.zib.de/wp-content/uploads/2024/03/acceleratorv01-300x300.png 300w, https://nhr.zib.de/wp-content/uploads/2024/03/acceleratorv01-150x150.png 150w, https://nhr.zib.de/wp-content/uploads/2024/03/acceleratorv01.png 434w" sizes="(max-width: 300px) 100vw, 300px" /></p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>HPC course Berlin, March 2024</title>
		<link>https://nhr.zib.de/hpc-course-berlin-march-2024/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Fri, 23 Feb 2024 08:19:02 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
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					<description><![CDATA[Course TU Berlin and NHR@ZIB]]></description>
										<content:encoded><![CDATA[<h2>Course Announcement</h2>
<p>Introduction to parallel programming with MPI and OpenMP<br />
March 11-15 2024</p>
<p>lecturer: Matthias Läuter<br />
location: Technische Universität Berlin and NHR at Zuse Institute Berlin<br />
language: German<br />
details and registration: <a href="http://www.tu.berlin/cfd/studium-lehre/datenverarbeitung/mpi">TU-Berlin</a></p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>Intel GPU MAX available on Lise</title>
		<link>https://nhr.zib.de/intelgpumax2024/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Mon, 19 Feb 2024 08:00:40 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
		<guid isPermaLink="false">https://nhr.zib.de/?p=16124</guid>

					<description><![CDATA[NHR@ZIB is happy to announce the availability of the first publicly available Intel GPU partition in Germany.]]></description>
										<content:encoded><![CDATA[<h2>Intel GPU MAX available on Lise</h2>
<p>NHR@ZIB is happy to announce the availability of the first publicly available Intel GPU partition in Germany.</p>
<p>Eight nodes, each equipped with four Intel Data Center GPU Max 1550 (also known as  Ponte Vecchio/PVC), two 56-core Intel &#8222;Sapphire Rapids&#8220; Xeon CPUs, 1 TB of RAM, and 3.6 TB of local NVMe storage are now available for all users.</p>
<p>The new partition allows users to run GPU workloads programmed in a cross-platform approach using OpenMP offloading (C/C++/Fortran) or SYCL  (C++ only). Both approaches are supported by Intel&#8217;s oneAPI which is available on the partition. Codes programmed in OpenMP or SYCL allow execution on both Nvidia and Intel (as well AMD) GPUs. The migration of  existing CUDA codes to SYCL can be assisted by tools. For AI workloads, PyTorch, TensorFlow, and (experimental) JAX are supported by oneAPI as well.</p>
<p>With Lise&#8217;s existing A100 partition, NHR@ZIB provides the great opportunity to explore and compare both architectures within the same HPC system. For more information please visit the</p>
<p><a href="https://user.nhr.zib.de/wiki/x/8ZEG">User Manual for Lise partitions</a></p>
<p>&nbsp;</p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>Refreshment for User Manual and Portal</title>
		<link>https://nhr.zib.de/manual_and_portal2024/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Tue, 13 Feb 2024 07:43:03 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
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					<description><![CDATA[We have refreshed the online presence for the system Lise in Berlin.]]></description>
										<content:encoded><![CDATA[<h2>Refreshment for User Manual and Portal</h2>
<p>we have refreshed the online presence for the system Lise in Berlin. You can find</p>
<ul>
<li>general information on <a href="https://nhr.zib.de/">nhr.zib.de</a>,</li>
<li>the User Manual on <a href="https://user.nhr.zib.de">user.nhr.zib.de</a>, and</li>
<li>the Portal NHR@ZIB (for project and account management) on <a href="https://portal.nhr.zib.de">portal.nhr.zib.de</a>.</li>
</ul>
<p>Best regards<br />
NHR@ZIB</p>
]]></content:encoded>
					
		
		
			</item>
		<item>
		<title>Parallel programming day, January 2024</title>
		<link>https://nhr.zib.de/parallel-programming-day-january-2024de/</link>
		
		<dc:creator><![CDATA[Matthias Läuter]]></dc:creator>
		<pubDate>Fri, 05 Jan 2024 15:32:59 +0000</pubDate>
				<category><![CDATA[Neueste Beiträge]]></category>
		<guid isPermaLink="false">https://nhr.zib.de/?p=16004</guid>

					<description><![CDATA[online course NHR@ZIB and NHR@GWDG]]></description>
										<content:encoded><![CDATA[<h2>Course announcement</h2>
<p id="page-title" class="title colwidth-four">Parallel programming day<br />
January 2024</p>
<p>lecturer: Dr. Christian Köhler (<a class="external-link" href="https://gwdg.de/community-pages/nhr-intro/" rel="nofollow">NHR@GWDG</a>), Dr. Matthias Läuter (<a class="external-link" href="https://nhr.zib.de/" rel="nofollow">NHR@ZIB</a>), Dr. Lewin Stein (<a class="external-link" href="https://nhr.zib.de/" rel="nofollow">NHR@ZIB</a>)<br />
details and registration: <a href="https://user.nhr.zib.de/wiki/spaces/PUB/pages/429948/Parallel+programming+day+01-2024">workshop page</a></p>
]]></content:encoded>
					
		
		
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